본 과제는 DRAM PIM 개발에 있어서, 복잡한 설계 규칙과 제한 사항을 고려한 배치 및 배선 과정에서의 최적화 설계 방법론 개발 목적. DRAM PIM 성능을 향상시키기 위해서, DRAM PIM 요소 IP들의 마크로 블록의 배치 및 배선 과정을 최적화 및 자동화하는 SW를 개발하고, bandwidth를 고려하여 signal integrity를 최적화하고, 머신러닝을 활용한 예측 모델로 SW의 성능을 향상

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